דרושים » פיתוח חומרה » V V Manager לחברת מדיקל מובילה!!!

דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
 

חברת השמה / כח אדם

לפני 2 שעות
QHR
Location: More than one
Job Type: Full Time
Manage and mentor a growing V V team, fostering a culture of quality, accountability, and continuous improvement.Define and lead the V V strategy, master plans, and schedules aligned to product development cycles and regulatory requirements. Coordinate V V activities with external testing laboratories and vendors to ensure high-quality and timely deliverables.
Champion continuous improvement of V V tools, methodologies, and infrastructure
Oversee and execute verification and validation activities, including protocol design, testing, and ation for capital systems and disposable devices.
Ensure robust TEST method development, validation, and equipment qualification in accordance with industry and regulatory standards.Drive readiness for regulatory submissions and audits through comprehensive V V ation and compliance.Partner closely with R D, Quality Assurance, Regulatory Affairs,
Requirements:
Bachelors or Masters degree in Biomedical Engineering, Mechanical Engineering, Electrical Engineering, or a related technical field.
Minimum of 5 years of progressive experience as a V V manager within the medical device industry
Proven experience in leadership or management roles.
Proven ability to build and scale V V infrastructure or teams
Demonstrated expertise in capital equipment and disposable device testing, including system -level and component-level V V.
Familiarity with software validation and automated TEST systems.
In-depth knowledge of design controls, risk management, and regulatory frameworks(FDA, ISO 13485, ISO 14971, IEC 60601, EU MDR).Proficiency in  TEST method development, statistical analysis, and  TEST method validation (TMV).Strong leadership, project management, and cross-functional collaboration
.המשרה מיועדת לנשים ולגברים כאחד
 
Hide
הגשת מועמדות
עדכון קורות החיים לפני שליחה
123239
שירות זה פתוח ללקוחות VIP בלבד
משרות דומות שיכולות לעניין אותך
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
3 ימים
Cisco
Location: Caesarea
Job Type: Full Time
Join the Cisco Silicon One Front-End Design Verification team, responsible for validating the most advanced networking silicon in the world. Our team ensures functional correctness, quality, and reliability across the entire design flow. We combine state-of-the-art methodologies with a collaborative, startup-like culture, while being backed by the stability and resources of Cisco.

Your Impact

Develop advanced verification environments using SystemVerilog and UVM
Write, run, and debug testbenches to ensure complete functional coverage
Drive pre-silicon and in-lab debug activities to resolve complex issues
Collaborate with RTL, architecture, and physical design teams to achieve design closure
Support methodology development, scripting, and automation to enhance productivity
Contribute to the success of Cisco Silicon One, powering the next generation of Internet infrastructure
Requirements:
Minimum Qualifications

6+ years of experience in digital logic design verification
Advanced knowledge of SystemVerilog and UVM
Strong debug skills both pre-silicon and in-lab

Preferred Qualifications

Scripting skills (Python, Perl, TCL, or shell)
Experience with system-level integration (AMBA, PCIe, SPI, I2C, JTAG, CPU)
Basic software knowledge (driver-level)
Basic design knowledge and familiarity with CDC concepts
.המשרה מיועדת לנשים ולגברים כאחד
 
Show more...
הגשת מועמדות
עדכון קורות החיים לפני שליחה
120439
שירות זה פתוח ללקוחות VIP בלבד
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
3 ימים
Cisco
Location: Caesarea
Job Type: Full Time
Join the Cisco Silicon One Front-End Design Verification team, responsible for validating the most advanced networking silicon in the world. Our team ensures functional correctness, quality, and reliability across the entire design flow. We combine state-of-the-art methodologies with a collaborative, startup-like culture, while being backed by the stability and resources of Cisco.

Your Impact

Develop advanced verification environments using SystemVerilog and UVM
Write, run, and debug testbenches to ensure complete functional coverage
Drive pre-silicon and in-lab debug activities to resolve complex issues
Collaborate with RTL, architecture, and physical design teams to achieve design closure
Support methodology development, scripting, and automation to enhance productivity
Contribute to the success of Cisco Silicon One, powering the next generation of Internet infrastructure
Requirements:
Minimum Qualifications

6+ years of experience in digital logic design verification
Advanced knowledge of SystemVerilog and UVM
Strong debug skills both pre-silicon and in-lab

Preferred Qualifications

Scripting skills (Python, Perl, TCL, or shell)
Experience with system-level integration (AMBA, PCIe, SPI, I2C, JTAG, CPU)
Basic software knowledge (driver-level)
Basic design knowledge and familiarity with CDC concepts
.המשרה מיועדת לנשים ולגברים כאחד
 
Show more...
הגשת מועמדות
עדכון קורות החיים לפני שליחה
120441
שירות זה פתוח ללקוחות VIP בלבד
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
לפני 1 שעות
Google Israel
Location: Tel Aviv-Yafo and Haifa
Job Type: Full Time
The AI and Infrastructure team works on the worlds toughest problems, redefining whats possible and the possible easy. We empower Google customers by delivering AI and Infrastructure at unparalleled scale, efficiency, reliability and velocity. Our customers include Googlers, Googler Cloud customers, and billions of Google users worldwide. Were at the center of amazing work at Google by being the flywheel that enables our advanced AI models, delivers computing power across global services, and offers platforms that developers use to build services.

In AI and Infrastructure, we shape the future of hyperscale computing by inventing and creating world-leading future technology, and drive global impact by contributing to Google infrastructure, from software to hardware (including building Vertex AI for Google Cloud). We work on complex technologies at a global scale with key players in the AI and systems space. Join a team of talented individuals who not only work together to keep data centers operating efficiently but also create a legacy of driving innovation by building some of the most complex systems technologies.


Responsibilities
Plan the verification of digital design blocks by fully understanding the design specification and interacting with design engineers to identify important verification scenarios.
Create and enhance constrained-random verification environments using SystemVerilog and UVM, or formally verify designs with SVA and industry leading formal tools.
Identify and write all types of coverage measures for corner-cases.
Debug tests with design engineers to deliver functionally correct design blocks.
Close coverage measures to identify verification holes and to show progress towards tape-out.
Requirements:
Minimum qualifications:
Bachelor's degree in Electrical Engineering or equivalent practical experience.
8 years of experience with creating and using verification components and environments in standard verification methodology.
Experience verifying digital logic at RTL level using SystemVerilog or Specman/E for FPGAs or ASICs.

Preferred qualifications:
Master's degree or PhD in Electrical Engineering.
Experience with verification techniques, and the full verification life cycle.
Experience with performance verification of ASICs and ASIC components.
Experience with ASIC standard interfaces and memory system architecture.
Experience in 4 or more SOC cycles.
.המשרה מיועדת לנשים ולגברים כאחד
 
Show more...
הגשת מועמדות
עדכון קורות החיים לפני שליחה
120884
שירות זה פתוח ללקוחות VIP בלבד
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
לפני 4 שעות
Google Israel
Location: Tel Aviv-Yafo and Haifa
Job Type: Full Time
Be part of a team that pushes boundaries, developing custom silicon solutions that power the future of Google's direct-to-consumer products. You'll contribute to the innovation behind products loved by millions worldwide. Your expertise will shape the next generation of hardware experiences, delivering unparalleled performance, efficiency, and integration.
As a Design Verification Engineer, you will work as part of a Research and Development team building verification components, constrained-random testing, system testing, and verification closure. As part of our server chip design team, you will verify digital designs. You will collaborate with design and verification engineers in active projects and perform verification. You will be responsible for the full life-cycle of verification which can range from verification planning, test execution or collecting and closing coverage.

The AI and Infrastructure team is redefining whats possible. We empower Google customers with breakthrough capabilities and insights by delivering AI and Infrastructure at unparalleled scale, efficiency, reliability and velocity. Our customers include Googlers, Google Cloud customers, and billions of Google users worldwide.

We're the driving force behind Google's groundbreaking innovations, empowering the development of our cutting-edge AI models, delivering unparalleled computing power to global services, and providing the essential platforms that enable developers to build the future. From software to hardware our teams are shaping the future of world-leading hyperscale computing, with key teams working on the development of our TPUs, Vertex AI for Google Cloud, Google Global Networking, Data Center operations, systems research, and much more.

Responsibilities
Plan the verification of digital design blocks by fully understanding the design specification and interacting with design engineers to identify important verification scenarios.
Create and enhance constrained-random verification environments using SystemVerilog or formally verify designs with SystemVerilog Assertions (SVA) and industry leading formal tools.
Identify and write all types of coverage measures for stimulus and corner-cases.
Debug tests with design engineers to deliver functionally correct design blocks.
Apply close coverage measures to identify verification holes and to show progress towards tape-out.
Requirements:
Minimum qualifications:
Bachelor's degree in Electrical Engineering, Computer Engineering, Computer Science, a related field, or equivalent practical experience.
1 year of experience creating and using verification components and environments in standard verification methodology.
Experience verifying digital logic at Register Transfer Level (RTL) level using SystemVerilog or Specman/E for Field Programmable Gate Arrays or ASICs.

Preferred qualifications:
Masters degree in Electrical Engineering, Computer Science, or a related field.
Experience with Universal Verification Methodology (UVM), SystemVerilog, or other scripting languages (e.g., Python, Perl, Shell, Bash, etc.).
Experience with CPU implementation, assembly language or compute SOCs.
.המשרה מיועדת לנשים ולגברים כאחד
 
Show more...
הגשת מועמדות
עדכון קורות החיים לפני שליחה
120911
שירות זה פתוח ללקוחות VIP בלבד
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
3 ימים
Cisco
Location: Caesarea
Job Type: Full Time
Join the Front-End Design team at Cisco Silicon One, responsible for the entire chip design process - from definition and microarchitecture to final production.

Our engineers are hands-on in every stage: definition, design, verification, signoff, and validation, all the way through to silicon bring-up and customer deployment. By applying the latest silicon technologies and methodologies, we develop some of the worlds largest-scale and most sophisticated devices, pushing the boundaries of whats possible.

Your Impact
Contribute to the design and verification of Cisco Silicon One devices across the full development lifecycle.
Write and execute test plans in SystemVerilog and UVM.
Perform advanced debug both pre-silicon and in the lab.
Support system integration, validation, and post-silicon bring-up.
Collaborate closely with cross-functional teams to deliver industry-leading, programmable silicon solutions.
Requirements:
Minimum Qualifications
3+ years of experience in digital logic design verification.
Advanced knowledge of SystemVerilog and UVM.
Strong debugging skills, both pre-silicon and in-lab environments.

Preferred Qualifications
Scripting experience (Python, Perl, or TCL).
Familiarity with system integration (AMBA, PCIe, SPI, I2C, JTAG, CPU).
Basic software knowledge (e.g., driver-level programming).
Basic design knowledge.
.המשרה מיועדת לנשים ולגברים כאחד
 
Show more...
הגשת מועמדות
עדכון קורות החיים לפני שליחה
120442
שירות זה פתוח ללקוחות VIP בלבד
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
לפני 4 שעות
Google Israel
Location: Tel Aviv-Yafo and Haifa
Job Type: Full Time
The AI and Infrastructure team is redefining whats possible. We empower Google customers with breakthrough capabilities and insights by delivering AI and Infrastructure at unparalleled scale, efficiency, reliability and velocity. Our customers include Googlers, Google Cloud customers, and billions of Google users worldwide.

We're the driving force behind Google's groundbreaking innovations, empowering the development of our AI models, delivering unparalleled computing power to global services, and providing the essential platforms that enable developers to build the future. From software to hardware our teams are shaping the future of world-leading hyperscale computing, with key teams working on the development of our TPUs, Vertex AI for Google Cloud, Google Global Networking, Data Center operations, systems research, and much more.

Responsibilities
Plan the verification of digital design blocks by fully understanding the design specification and interacting with design engineers to identify important verification scenarios.
Create and enhance constrained-random verification environments using SystemVerilog and Universal Verification Methodology (UVM), or formally verify designs with SystemVerilog Assertion (SVA) and industry leading formal tools.
Identify and write all types of coverage measures for corner-cases.
Debug tests with design engineers to deliver functionally correct design blocks.
Close coverage measures to identify verification holes and to show progress towards tape-out.
Requirements:
Minimum qualifications:
Bachelor's degree in Electrical Engineering, Computer Engineering, Computer Science, or a related field, or equivalent practical experience.
4 years of experience with creating and using verification components and environments in standard verification methodology.
Experience verifying digital systems using standard IP components/interconnects (microprocessor cores, hierarchical memory subsystems).
Experience verifying digital logic at RTL level using SystemVerilog or Specman/E for FPGAs or ASICs.

Preferred qualifications:
Master's degree or PhD in Electrical Engineering, Computer Engineering or Computer Science, with an emphasis on computer architecture.
Experience with verification techniques, and the full verification life-cycle.
Experience with performance verification of ASICs and ASIC components.
Experience with ASIC standard interfaces and memory system architecture.
.המשרה מיועדת לנשים ולגברים כאחד
 
Show more...
הגשת מועמדות
עדכון קורות החיים לפני שליחה
120885
שירות זה פתוח ללקוחות VIP בלבד
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
לפני 3 שעות
Google Israel
Location: Tel Aviv-Yafo and Haifa
Job Type: Full Time
The AI and Infrastructure team is redefining whats possible. We empower Google customers with breakthrough capabilities and insights by delivering AI and Infrastructure at unparalleled scale, efficiency, reliability and velocity. Our customers include Googlers, Google Cloud customers, and billions of Google users worldwide.

We're the driving force behind Google's groundbreaking innovations, empowering the development of our cutting-edge AI models, delivering unparalleled computing power to global services, and providing the essential platforms that enable developers to build the future. From software to hardware our teams are shaping the future of world-leading hyperscale computing, with key teams working on the development of our TPUs, Vertex AI for Google Cloud, Google Global Networking, Data Center operations, systems research, and much more.

Responsibilities
Plan the verification of digital design blocks by fully understanding the design specification and interacting with design engineers to identify important verification scenarios.
Create and enhance constrained-random verification environments using SystemVerilog/UVM, or Specman.
Identify and write all types of coverage measures for stimulus and corner-cases.
Debug tests with design engineers to deliver functionally correct design blocks.
Lead coverage measures to identify verification holes and to show progress towards tape-out.
Requirements:
Minimum qualifications:
Bachelor's degree in Electrical Engineering or equivalent practical experience.
3 years of experience verifying digital logic at RTL level using SystemVerilog, or Specman/E for FPGAs or ASICs.
Experience creating and using verification components and environments in standard verification methodology.
Experience verifying digital systems using standard IP components/interconnects (e.g., microprocessor cores, hierarchical memory subsystems).

Preferred qualifications:
Masters degree in Electrical Engineering, Computer Science, or a related field.
Experience with UVM, SystemVerilog, or other scripting languages (e.g., Python, Perl, Shell, Bash, etc.).
Experience with CPU implementation, assembly language, or compute System on a Chip (SOC).
.המשרה מיועדת לנשים ולגברים כאחד
 
Show more...
הגשת מועמדות
עדכון קורות החיים לפני שליחה
120892
שירות זה פתוח ללקוחות VIP בלבד
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
לפני 5 שעות
Google Israel
Location: Tel Aviv-Yafo and Haifa
Job Type: Full Time
Be part of a team that pushes boundaries, developing custom silicon solutions that power the future of Google's direct-to-consumer products. You'll contribute to the innovation behind products loved by millions worldwide. Your expertise will shape the next generation of hardware experiences, delivering unparalleled performance, efficiency, and integration.The AI and Infrastructure team is redefining whats possible. We empower Google customers with breakthrough capabilities and insights by delivering AI and Infrastructure at unparalleled scale, efficiency, reliability and velocity. Our customers include Googlers, Google Cloud customers, and billions of Google users worldwide.

We're the driving force behind Google's groundbreaking innovations, empowering the development of our cutting-edge AI models, delivering unparalleled computing power to global services, and providing the essential platforms that enable developers to build the future. From software to hardware our teams are shaping the future of world-leading hyperscale computing, with key teams working on the development of our TPUs, Vertex AI for Google Cloud, Google Global Networking, Data Center operations, systems research, and much more.
Responsibilities
Define, develop and execute post-silicon validation content on both pre-silicon setups and real silicon platforms in the lab.
Drive silicon from being a chip towards becoming a product.
Debug and investigate issues along cross-functional teams such as Firmware, Software, Design, Design Verification (DV), Architecture and multiple production teams.
Provide a quality functional coverage for Google designs.
Design, implement, and maintain validation tests using scripting and programming languages (e.g., Python, C/C++) to verify SmartNIC functionality and performance.
Requirements:
Minimum qualifications:
Bachelor's degree in Electrical/Computer Engineering, Computer Science, a related field, or equivalent practical experience.
3 years of experience with functional tests for silicon validation (i.e., writing in C or C++) or developing firmware, and embedded software.
Experience with silicon bring-up, functional validation, characterizing, and qualifying silicon.
Experience with SoC architecture, including boot flows.

Preferred qualifications:
Experience validating key SmartNIC features, including Ethernet interface (SerDes, MAC + PCS) PCIe high-speed interface, network protocols (e.g., Ethernet, RDMA, NVMe), packet processing, data path, packet buffering, and embedded processors/firmware.
Experience with hardware prototyping, including hardware/software integration (i.e., pre-silicon use of emulation, software-based test, and diagnostics development).
Experience with board schematics, layout, and debug methodologies using lab equipment.
Experience in SmartNIC, Network Processor, or high-speed Networking/Storage ASIC validation.
.המשרה מיועדת לנשים ולגברים כאחד
 
Show more...
הגשת מועמדות
עדכון קורות החיים לפני שליחה
120887
שירות זה פתוח ללקוחות VIP בלבד
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
 

חברת השמה / כח אדם

לפני 5 שעות
SVT
מיקום המשרה: מספר מקומות
סוג משרה: משרה מלאה
לחברת מדיקל צומחת גלובלית ומצליחה דרוש/ה מנהל /ת מחלקה ל V&V

במסגרת התפקיד:

ניהול והובלת צוות V&V מתפתח, כולל חניכה מקצועית ובניית תרבות של איכות, אחריות ושיפור מתמיד.

הגדרה והובלת אסטרטגיית V&V, תוכניות אב ולוחות זמנים בהתאם למחזורי פיתוח המוצר ודרישות רגולטוריות.

תיאום פעילויות V&V מול מעבדות בדיקה חיצוניות וספקים, כולל הבטחת עמידה בDeliverables איכותיים ובזמן.

הובלת שיפור מתמיד של מתודולוגיות, כלים ותשתיות V&V.

פיקוח וביצוע פעילויות Verification וValidation, כולל כתיבת פרוטוקולים, ביצוע בדיקות ותיעוד עבור מערכות קפיטל ודיספוזבל.

הבטחת פיתוח ושדרוג שיטות בדיקה, ולידציה וQualification של ציוד בהתאם לסטנדרטים.

הובלת מוכנות להגשות רגולטוריות ולביקורות באמצעות תיעוד V&V מלא, מדויק ומותאם לדרישות.

עבודה אינטגרטיבית עם צוותי מופ, איכות, רגולציה, קליניקה וייצור לבניית תוכניות V&V מבוססות סיכונים.

השתתפות פעילה בDesign Reviews, הערכות סיכונים לפי ISO 14971, ובניית ותחזוקת D
דרישות:
תואר ראשון/שני בהנדסה ביורפואית, מכונות, חשמל או תחום טכנולוגי קרוב.

לפחות 5 שנות ניסיון מצטבר בתפקידי V&V בתעשיית המכשור הרפואי חובה.

ניסיון מוכח בניהול צוותים או הובלה טכנית.

יכולת מוכחת בבניית תשתיות V&V או סקיילינג של פעילויות V&V.

מומחיות בבדיקות מכשור רפואי (Capital Equipment + Disposable), ברמת מערכת ורכיבים.

היכרות עם ולידציית תוכנה ומערכות בדיקה אוטומטיות.

ידע מעמיק בDesign Controls, ניהול סיכונים ומסגרות רגולטוריות (FDA, ISO 13485, ISO 14971, IEC 60601, EU MDR).

מיומנות בפיתוח שיטות בדיקה, ניתוח סטטיסטי וTMV.

ניסיון מוכח בהעברת תכן לייצור וManufacturing Validation.

שליטה מלאה בעברית ובאנגלית בכתב ובעל פה. המשרה מיועדת לנשים ולגברים כאחד.
 
עוד...
הגשת מועמדות
עדכון קורות החיים לפני שליחה
123175
שירות זה פתוח ללקוחות VIP בלבד
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
 

חברת השמה / כח אדם

2 ימים
SQLink
מיקום המשרה: מספר מקומות
סוג משרה: משרה מלאה
חברת מדיקל גלובלית באיזור הצפון מגייסת Verification engineer
התפקיד כולל: ביצוע בדיקות למערכות רפואיות מורכבות, כתיבת מסמכי בדיקות, איתור באגים, עבודה מול מגוון ממשקים ועוד.
דרישות:
- שנתיים ניסיון בבדיקות למערכות מולטידיסציפלינריות
- ניסיון בכתיבת מסמכי בדיקות
- אנגלית ברמה גבוהה
- תואר ראשון בהנדסה
- ניסיון קודם מחברה בתחום המדיקל - יתרון משמעותי המשרה מיועדת לנשים ולגברים כאחד.
 
עוד...
הגשת מועמדות
עדכון קורות החיים לפני שליחה
122356
שירות זה פתוח ללקוחות VIP בלבד